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CPLD adota tecnologias de programação como EPROM CMOS, EEPROM, memória flash e SRAM para formar um dispositivo lógico programável com alta densidade, alta velocidade e baixo consumo de energia. CPLD é composta principalmente de três partes: bloco lógico programável de canal de interconexão e bloco I/O. O bloco lógico em CPLD é semelhante a uma pequena PLD, geralmente um bloco lógico contém 4-20 macrocells, e cada macrocell é geralmente composto por uma matriz de item do produto, um item do produto de alocação e um registo programáveis. Cada unidade de macro tem uma variedade de métodos de configuração, e cada unidade de macro também pode ser usado em cascata, de modo que a lógica de forma mais complexa e funções de lógica sequencial pode ser realizado. Para incluíndo CPLDs com maior nível de integração, um bloco com matriz incorporado no chip de RAM/ROM é normalmente fornecida. Canais de interconexão programáveis fornecem principalmente redes de interconexão entre os blocos de lógica, macrocells, e os pinos de entrada/saída. O bloco de entrada/saída (E/S do bloco) fornece a interface entre a lógica interna e os pinos E/S de dispositivo. Incluíndo CPLDs com escalas lógica maiores geralmente têm Boundary Scan JTAG teste os circuitos que podem executar testes do sistema global de alta densidade programadas dispositivos lógicos programáveis. Além disso, a programação do sistema pode também ser efectuada através da interface JTAG.
1.o diagrama de PIN: 
2. MAX 7000B I/O Curso Durante Seqüenciamento de energia:
Altera identificou que a sequência de potência específicas situações envolvendo os tempos de subida lenta no VCCIO ou tensão do pino de E/S podem causar MAX 7000B os pinos E/S para a fonte/pia antes VCCINT atual é aumentada. Estas condições podem violar a definição de Ligações com metal ou a quente que indica que esses pinos deve ser tri-declarou durante a partida e não deve fonte/dissipador de calor mais de 300 μA de corrente por pin. Existem dois tipos diferentes de seqüência de situações em que os pinos E/S de maio de fonte de corrente ou maior que 300 μA.Quadro 2 descreve as duas questões de sequência e suas possíveis soluções alternativas.
3.I/S durante o rápido aumento Vccint transitórios:
Altera identificou que o rápido aumento VCCINT vezes pode levar a pulsos no pinos E/S durante o período de alimentação on Max® 7000AE, MAX 3000A e MAX 7000B dispositivos. Esta condição pode violar a definição de Ligações com metal ou a quente que afirma que estes pinos devem ser tri-declarou durante a partida e não deve fonte ou afundar mais de 300 μA de corrente por pin. Existem dois tipos diferentes de pulsos resultantes do rápido aumento VCCINT vezes, um pulso baixo no transiente qualquer pino/S e um pulso separado sobre os pinos de saída combinatorial transiente.O Quadro 3 mostra os problemas e o MAX dispositivos que afetam a.
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